diff --git a/Cortex-M0/soclabs_demo/systems/cortex_m0_mcu/rtl_sim/makefile b/Cortex-M0/soclabs_demo/systems/cortex_m0_mcu/rtl_sim/makefile
index cdae0a1f386792ae5346323d159d123059cdfba5..b97bd947641d82dbb00c19cc7224ef36fe94f727 100644
--- a/Cortex-M0/soclabs_demo/systems/cortex_m0_mcu/rtl_sim/makefile
+++ b/Cortex-M0/soclabs_demo/systems/cortex_m0_mcu/rtl_sim/makefile
@@ -9,6 +9,39 @@
# Copyright © 2021, SoC Labs (www.soclabs.org)
#-----------------------------------------------------------------------------
+#-------------------------------------
+# - Directory Setups
+#-------------------------------------
+# Directory of Testcodes
+TESTCODES_DIR := $(ARM_CMSDK_SW_DIR)/testcodes
+
+# Project System Directory
+FPGA_IMP_DIR := $(SOCLABS_PROJECT_DIR)/imp/fpga
+PROJ_SYS_DIR := $(SOCLABS_PROJECT_DIR)/system
+PROJ_SW_DIR ?= $(PROJ_SYS_DIR)/testcodes
+
+# Directory to put simulation files
+SIM_TOP_DIR ?= $(SOCLABS_PROJECT_DIR)/simulate/sim
+SIM_DIR = $(SIM_TOP_DIR)/$(TESTNAME)
+
+#-------------------------------------
+# - Test List Variables
+#-------------------------------------
+# List of all tests (this is used when running 'make all/clean')
+TEST_LIST_FILE ?= $(TESTCODES_DIR)/software_list.txt
+TEST_LIST_FILE += $(PROJ_SW_DIR)/software_list.txt
+TEST_LIST = $(shell cat $(TEST_LIST_FILE) | while read line || [ -n "$$line" ]; do echo $$line; done)
+
+# List of Tests to Exclude from Regression
+EXCLUDE_LIST_FLIE = $(PROJ_SW_DIR)/regression_exclude.txt
+
+#-------------------------------------
+# - Verilog Defines and Filelists
+#-------------------------------------
+# Simulator/Lint Defines
+DEFINES_VC += +define+CORTEX_M0 +define+USE_TARMAC
+
+
#-----------------------------------------------------------------------------
# The confidential and proprietary information contained in this file may
# only be used by a person authorised under and to the extent permitted
@@ -77,7 +110,7 @@ endif
# Select Verilog Command File based on CPU type
ifeq ($(CPU_PRODUCT),CORTEX_M0)
# For Cortex-M0 product users
- TBENCH_VC = ../verilog/tbench_M0.vc
+ TBENCH_VC = $(ARM_CMSDK_MCU_DIR)/verilog/tbench_M0.flist
endif
ifeq ($(CPU_PRODUCT),CORTEX_M0_DS)
@@ -85,9 +118,10 @@ ifeq ($(CPU_PRODUCT),CORTEX_M0_DS)
TBENCH_VC = ../verilog/tbench_M0_DS.vc
endif
+TB_TOP ?= tb_cmsdk_mcu
-# Simulator type (mti/vcs/nc)
+# Simulator type (mti/vcs/nc/xm)
SIMULATOR = mti
# MTI option
@@ -104,6 +138,10 @@ VCS_VC_OPTIONS = -f $(TBENCH_VC)
NCSIM_OPTIONS = -unbuffered -status -LICQUEUE -f ncsim.args -cdslib cds.lib -hdlvar hdl.var -NBASYNC
NC_VC_OPTIONS = -f $(TBENCH_VC)
+# XM verilog options
+XMSIM_OPTIONS = -unbuffered -64bit -status -LICQUEUE -f xmsim.args -cdslib cds.lib -hdlvar hdl.var -NBASYNC
+XM_VC_OPTIONS = -f $(TBENCH_VC)
+
# Boot Loader image
BOOTLOADER = bootloader
# Debug Tester image
@@ -137,8 +175,8 @@ compile_vcs :
# Run simulation in batch mode
run_vcs : code
- @if [ ! -d logs ] ; then \
- mkdir logs; \
+ @if [ ! -d $(SIM_DIR)/logs ] ; then \
+ mkdir -p $(SIM_DIR)/logs; \
fi
@echo quit > quit.do
./simv $(VCS_SIM_OPTION) < quit.do | tee logs/run_$(TESTNAME).log ;
@@ -149,8 +187,8 @@ sim_vcs : code
# Compile RTL, and run all tests in batch mode
all_vcs : compile_vcs bootrom debugtester
- @if [ ! -d logs ] ; then \
- mkdir logs; \
+ @if [ ! -d $(SIM_DIR)/logs ] ; then \
+ mkdir -p $(SIM_DIR)/logs; \
fi
@echo quit > quit.do
@echo Run tests ...
@@ -169,72 +207,116 @@ all_vcs : compile_vcs bootrom debugtester
# Compile RTL
compile_nc :
- ncprep +overwrite $(NC_VC_OPTIONS) +debug | tee compile_nc.log
- ncvlog -work worklib -f ncvlog.args | tee -a compile_nc.log
- ncelab -mess -f ncelab.args -access +r | tee -a compile_nc.log
+ @if [ ! -d $(SIM_DIR)/logs ] ; then \
+ mkdir -p $(SIM_DIR)/logs; \
+ fi
+ cd $(SIM_DIR); ncprep +overwrite $(NC_VC_OPTIONS) +debug | tee logs/compile_nc.log
+ cd $(SIM_DIR); ncvlog -work worklib -f ncvlog.args | tee -a logs/compile_nc.log
+ cd $(SIM_DIR); ncelab -mess -f ncelab.args -access +r | tee -a logs/compile_nc.log
# Note : If coverage is required, you can add -coverage all to ncelab
# Run simulation in batch mode
run_nc : code
- @if [ ! -d logs ] ; then \
- mkdir logs; \
+ @if [ ! -d $(SIM_DIR)/logs ] ; then \
+ mkdir -p $(SIM_DIR)/logs; \
fi
- @echo run > run.tcl.tmp
- @echo exit >> run.tcl.tmp
- @mv run.tcl.tmp run.tcl
- ncsim $(NCSIM_OPTIONS) -input run.tcl | tee logs/run_$(TESTNAME).log ;
+ @echo run > $(SIM_DIR)/run.tcl.tmp
+ @echo exit >> $(SIM_DIR)/run.tcl.tmp
+ @mv $(SIM_DIR)/run.tcl.tmp $(SIM_DIR)/run.tcl
+ cd $(SIM_DIR); ncsim $(NCSIM_OPTIONS) -input run.tcl | tee logs/run_$(TESTNAME).log ;
# Run simulation in interactive mode
sim_nc : code
- ncsim -gui $(NCSIM_OPTIONS)
+ cd $(SIM_DIR); ncsim -gui $(NCSIM_OPTIONS)
# Compile RTL, and run all tests in batch mode
all_nc : compile_nc bootrom debugtester
- @if [ ! -d logs ] ; then \
- mkdir logs; \
+ @if [ ! -d $(SIM_DIR)/logs ] ; then \
+ mkdir -p $(SIM_DIR)/logs; \
fi
- @echo run > run.tcl.tmp
- @echo exit >> run.tcl.tmp
- @mv run.tcl.tmp run.tcl
+ @echo run > $(SIM_DIR)/run.tcl.tmp
+ @echo exit >> $(SIM_DIR)/run.tcl.tmp
+ @mv $(SIM_DIR)/run.tcl.tmp $(SIM_DIR)/run.tcl
@echo Run tests ...
for thistest in $(TEST_LIST) ; do \
echo $$thistest ; \
make testcode TESTNAME=$$thistest ;\
if [ -e image.hex ] ; then \
- ncsim $(NCSIM_OPTIONS) -input run.tcl | tee logs/run_$$thistest.log ;\
+ cd $(SIM_DIR); ncsim $(NCSIM_OPTIONS) -input run.tcl | tee logs/run_$$thistest.log ;\
else \
echo Cannot read image.hex ;\
exit 1; \
fi ; \
done
+# ------- XM -----------
+
+# Compile RTL
+compile_xm : bootrom
+ @if [ ! -d $(SIM_DIR)/logs ] ; then \
+ mkdir -p $(SIM_DIR)/logs; \
+ fi
+ cd $(SIM_DIR); xmprep +overwrite $(XM_VC_OPTIONS) $(DEFINES_VC) +debug -timescale 1ns/1ps -top $(TB_TOP) | tee logs/compile_xm.log
+ cd $(SIM_DIR); xmvlog -work worklib -f xmelab.args | tee -a logs/compile_xm.log
+ cd $(SIM_DIR); xmelab -mess -f xmelab.args -access +r | tee -a logs/compile_xm.log
+
+# Note : If coverage is required, you can add -coverage all to xmelab
+
+# Run simulation in batch mode
+run_xm : code compile_xm
+ @if [ ! -d $(SIM_DIR)/logs ] ; then \
+ mkdir -p $(SIM_DIR)/logs; \
+ fi
+ @echo run > $(SIM_DIR)/run.tcl.tmp
+ @echo exit >> $(SIM_DIR)/run.tcl.tmp
+ @mv $(SIM_DIR)/run.tcl.tmp $(SIM_DIR)/run.tcl
+ cd $(SIM_DIR); xmsim $(XMSIM_OPTIONS) -input run.tcl | tee logs/run_$(TESTNAME).log ;
+
+# Run simulation in interactive mode
+sim_xm : code compile_xm
+ cd $(SIM_DIR); xmsim -gui $(XMSIM_OPTIONS)
+
+
# ------- MTI -----------
# Compile RTL
-compile_mti :
+compile_mti : bootrom
+ @mkdir -p $(SIM_DIR)/logs
+ @cd $(SIM_DIR)
@if [ -d work ] ; then \
true ; \
else \
- vlib work; \
+ cd $(SIM_DIR); vlib work; \
fi
- vlog -incr -lint +v2k $(MTI_OPTIONS) $(MTI_VC_OPTIONS) | tee compile_mti.log
+ cd $(SIM_DIR); vlog -incr -lint +v2k $(MTI_OPTIONS) $(MTI_VC_OPTIONS) | tee logs/compile_mti.log
# Run simulation in batch mode
-run_mti : code
- @if [ ! -d logs ] ; then \
- mkdir logs; \
+run_mti : code compile_mti
+ @if [ ! -d $(SIM_DIR)/logs ] ; then \
+ mkdir -p $(SIM_DIR)/logs; \
fi
- vsim $(MTI_OPTIONS) -c tb_cmsdk_mcu -do "radix hex;run -all;quit -f" | tee logs/run_$(TESTNAME).log ;
+ @echo "run -all" > $(SIM_DIR)/run.tcl.tmp
+ @echo "quit -f" >> $(SIM_DIR)/run.tcl.tmp
+ @mv $(SIM_DIR)/run.tcl.tmp $(SIM_DIR)/run.tcl
+ cd $(SIM_DIR); vsim $(MTI_OPTIONS) -c $(TB_TOP) -do run.tcl | tee $(SIM_DIR)/logs/run_$(TESTNAME).log ;
+
+run_mti_to:
+ timeout 2s $(MAKE) run_mti >> /dev/null 2>&1
+
+run_mti_wrap:
+ $(MAKE) run_mti_to
# Run simulation in interactive mode
-sim_mti : code
- vsim $(MTI_OPTIONS) -gui tb_cmsdk_mcu &
+sim_mti : code compile_mti
+ cd $(SIM_DIR); vsim $(MTI_OPTIONS) -gui $(TB_TOP) &
# Create work directory
lib_mti :
vlib work
+
+
# Compile RTL, and run all tests in batch mode
all_mti : compile_mti bootrom debugtester
@if [ ! -d logs ] ; then \
@@ -261,13 +343,13 @@ code : testcode bootrom debugtester
# Compile bootloader
# Note : The use of ls after compile allows the computing server to sync up
bootrom:
- @(cd ../testcodes/$(BOOTLOADER) ;\
+ @(cd $(ARM_CMSDK_MCU_DIR)/testcodes/$(BOOTLOADER) ;\
make all $(SW_MAKE_OPTIONS) ;\
echo Compile done ;\
ls > /dev/null ;\
echo Copy $(BOOTLOADER).hex ;\
if [ -e $(BOOTLOADER).hex ] ; then \
- cp $(BOOTLOADER).hex ../../rtl_sim/$(BOOTLOADER).hex ;\
+ cp $(BOOTLOADER).hex $(SIM_DIR)/$(BOOTLOADER).hex ;\
else \
while [ ! -e $(BOOTLOADER).hex ] ; do \
echo Wait for hex file ...; \
@@ -275,14 +357,14 @@ bootrom:
sleep 5; \
done; \
if [ -e $(BOOTLOADER).hex ] ; then \
- cp $(BOOTLOADER).hex ../../rtl_sim/$(BOOTLOADER).hex ;\
+ cp $(BOOTLOADER).hex $(SIM_DIR)/$(BOOTLOADER).hex ;\
else \
echo Problem reading hex file ;\
exit 1; \
fi ;\
fi ;\
- cp $(BOOTLOADER).hex ../../rtl_sim/$(BOOTLOADER).hex ;\
- cd ../../rtl_sim )
+ cp $(BOOTLOADER).hex $(SIM_DIR)/$(BOOTLOADER).hex ;\
+ cd $(SIM_DIR) )
# Compile test code
# Note : The use of ls after compile allows the computing server to sync up
@@ -290,14 +372,14 @@ testcode:
ifeq ($(TESTNAME),)
$(error Please specify TESTNAME on the make command line)
endif
- @(if [ -d "../testcodes/$(TESTNAME)" ] ; then \
- cd ../testcodes/$(TESTNAME) ;\
+ @(if [ -d "$(ARM_CMSDK_MCU_DIR)/testcodes/$(TESTNAME)" ] ; then \
+ cd $(ARM_CMSDK_MCU_DIR)/testcodes/$(TESTNAME) ;\
make all $(SW_MAKE_OPTIONS) ; \
echo Compile done ;\
ls > /dev/null ;\
echo Copy $(TESTNAME).hex ;\
if [ -e $(TESTNAME).hex ] ; then \
- cp $(TESTNAME).hex ../../rtl_sim/image.hex ; \
+ cp $(TESTNAME).hex $(SIM_DIR)/image.hex ; \
else \
while [ ! -e $(TESTNAME).hex ] ; do \
echo Wait for $(TESTNAME).hex file ...; \
@@ -305,13 +387,18 @@ endif
sleep 5 ; \
done; \
if [ -e $(TESTNAME).hex ] ; then \
- cp $(TESTNAME).hex ../../rtl_sim/image.hex ; \
+ cp $(TESTNAME).hex $(SIM_DIR)/image.hex ; \
else \
echo Problem reading hex file ;\
exit 1; \
fi ;\
fi ;\
- cd ../../rtl_sim ;\
+ cd $(SIM_DIR) ;\
+ if [ -e $(ARM_CMSDK_MCU_DIR)/rtl_sim/adp.cmd ] ; then \
+ cp -p $(ARM_CMSDK_MCU_DIR)/rtl_sim/adp.cmd $(SIM_DIR)/adp.cmd ; \
+ else \
+ echo No adp.cmd file found ;\
+ fi ;\
else \
echo "ERROR: invalid TESTNAME value ( $(TESTNAME) )" ;\
exit 1 ;\
@@ -322,13 +409,13 @@ endif
# Compile debugtester
# Note : The use of ls after compile allows the computing server to sync up
debugtester:
- @(cd ../../../software/debug_tester ;\
+ @(cd $(ARM_CMSDK_SW_DIR)/debug_tester ;\
make all $(SW_MAKE_OPTIONS) ;\
echo Compile done ;\
ls > /dev/null ;\
echo Copy $(DEBUGTESTER)_le.hex ;\
if [ -e $(DEBUGTESTER)_le.hex ] ; then \
- cp $(DEBUGTESTER)_le.hex ../../systems/cortex_m0_mcu/rtl_sim/$(DEBUGTESTER)_le.hex ;\
+ cp $(DEBUGTESTER)_le.hex $(SIM_DIR)/$(DEBUGTESTER)_le.hex ;\
else \
while [ ! -e $(DEBUGTESTER)_le.hex ] ; do \
echo Wait for hex file ...; \
@@ -336,12 +423,12 @@ debugtester:
sleep 5 ; \
done; \
if [ -e $(DEBUGTESTER)_le.hex ] ; then \
- cp $(DEBUGTESTER)_le.hex ../../systems/cortex_m0_mcu/rtl_sim/$(DEBUGTESTER)_le.hex ;\
+ cp $(DEBUGTESTER)_le.hex $(SIM_DIR)/$(DEBUGTESTER)_le.hex ;\
fi ;\
fi ;\
echo Copy $(DEBUGTESTER)_be.hex ;\
if [ -e $(DEBUGTESTER)_be.hex ] ; then \
- cp $(DEBUGTESTER)_be.hex ../../systems/cortex_m0_mcu/rtl_sim/$(DEBUGTESTER)_be.hex ;\
+ cp $(DEBUGTESTER)_be.hex $(SIM_DIR)/$(DEBUGTESTER)_be.hex ;\
else \
while [ ! -e $(DEBUGTESTER)_be.hex ] ; do \
echo Wait for hex file ...;\
@@ -349,14 +436,14 @@ debugtester:
sleep 5 ; \
done; \
if [ -e $(DEBUGTESTER)_be.hex ] ; then \
- cp $(DEBUGTESTER)_be.hex ../../systems/cortex_m0_mcu/rtl_sim/$(DEBUGTESTER)_be.hex ;\
+ cp $(DEBUGTESTER)_be.hex $(SIM_DIR)/$(DEBUGTESTER)_be.hex ;\
fi ;\
fi ;\
if [ ! -e $(DEBUGTESTER)_le.hex ] && [ ! -e $(DEBUGTESTER)_be.hex ] ; then \
echo Problem reading hex file ;\
exit 1 ;\
fi ;\
- cd ../../systems/cortex_m0_mcu/rtl_sim )
+ cd $(SIM_DIR) )
# Compile all software including boot ROM
compile_all_code: bootrom debugtester
@@ -382,21 +469,25 @@ compile_all_code: bootrom debugtester
v2html:
echo building HTML tree
- @if [ ! -d ../v2html_doc ] ; then \
- mkdir ../v2html_doc; \
+ @if [ ! -d $(SOCLABS_PROJECT_DIR)/html/cmsdk/build ] ; then \
+ mkdir $(SOCLABS_PROJECT_DIR)/html; \
+ mkdir $(SOCLABS_PROJECT_DIR)/html/cmsdk; \
+ mkdir $(SOCLABS_PROJECT_DIR)/html/cmsdk/build; \
fi
- @(cd ../v2html_doc; \
+ @(cd $(SOCLABS_PROJECT_DIR)/html/cmsdk/build; )
rm *.html; rm *.gif; rm *.gz; \
- ~/tools/v2html -f ../verilog/v2html_M0.vc -ht cmsdk_mcu_system ; \
+ cd $(ARM_CMSDK_MCU_DIR)/rtl_sim ; \
+ ~/tools/v2html -o $(SOCLABS_PROJECT_DIR)/html/cmsdk/build -f ../verilog/v2html_M0.vc -ht cmsdk_mcu_system ;
+ @(cd $(SOCLABS_PROJECT_DIR)/html/cmsdk/build; )
cp -p tb_cmsdk_mcu.v.html hierarchy.html ; \
- cd ../rtl_sim ; )
- gtar zcvf ../v2html_doc.tgz ../v2html_doc
+ gtar zcvf $(SOCLABS_PROJECT_DIR)/html/cmsdk/v2html_doc.tgz $(SOCLABS_PROJECT_DIR)/html/cmsdk/build
+ cd $(ARM_CMSDK_MCU_DIR)/rtl_sim ;
# Remove all software compilation results
clean_all_code:
- @(cd ../../../software/debug_tester ; make clean; cd ../../systems/cortex_m0_mcu/rtl_sim; )
- @(cd ../testcodes/$(BOOTLOADER) ; make clean; cd ../../rtl_sim; )
+ @(cd $(ARM_CMSDK_SW_DIR)/debug_tester ; make clean; cd $(ARM_CMSDK_MCU_DIR)/rtl_sim; )
+ @(cd $(ARM_CMSDK_MCU_DIR)/testcodes/bootloader ; make clean; cd $(ARM_CMSDK_MCU_DIR)/rtl_sim; )
for thistest in $(TEST_LIST) ; do \
echo Cleaning $$thistest ... ; \
cd ../testcodes/$$thistest ; \
@@ -406,133 +497,16 @@ clean_all_code:
# Remove only bootloader and default selected test
clean_code:
- @(cd ../testcodes/$(BOOTLOADER) ; make clean; cd ../../rtl_sim; )
- @(cd ../testcodes/$(TESTNAME) ; make clean; cd ../../rtl_sim; )
+ @(cd $(ARM_CMSDK_MCU_DIR)/testcodes/$(BOOTLOADER) ; make clean; cd $(ARM_CMSDK_MCU_DIR)/rtl_sim; )
+ @(cd $(ARM_CMSDK_MCU_DIR)/testcodes/$(TESTNAME) ; make clean; cd $(ARM_CMSDK_MCU_DIR)/rtl_sim; )
# ------- clean -----------
# Remove RTL compile files, log files, software compile files
clean : clean_all_code
- @if [ -d work ] ; then \
- rm -rf work ; \
- fi
- @if [ -e tarmac0.log ] ; then \
- rm tarmac0.log ; \
- fi
- @if [ -e tarmac1.log ] ; then \
- rm tarmac1.log ; \
- fi
- @if [ -e tarmac0track.log ] ; then \
- rm tarmac0track.log ; \
- fi
- @if [ -e uart.log ] ; then \
- rm uart.log ; \
- fi
- @if [ -e uart0.log ] ; then \
- rm uart0.log ; \
- fi
- @if [ -e uart1.log ] ; then \
- rm uart1.log ; \
- fi
- @if [ -e uart2.log ] ; then \
- rm uart2.log ; \
- fi
- @if [ -e uart3.log ] ; then \
- rm uart3.log ; \
- fi
- @if [ -e vsim.wlf ] ; then \
- rm vsim.wlf ; \
- fi
- @if [ -e image.hex ] ; then \
- rm image.hex ; \
- fi
- @if [ -e bootloader.hex ] ; then \
- rm bootloader.hex ; \
- fi
- @if [ -e debugtester_le.hex ] ; then \
- rm debugtester_le.hex ; \
- fi
- @if [ -e debugtester_be.hex ] ; then \
- rm debugtester_be.hex ; \
- fi
- @if [ -e compile_mti.log ] ; then \
- rm compile_mti.log ; \
- fi
- @if [ -e compile_vcs.log ] ; then \
- rm compile_vcs.log ; \
- fi
- @if [ -e compile_nc.log ] ; then \
- rm compile_nc.log ; \
- fi
- @if [ -e transcript ] ; then \
- rm transcript ; \
- fi
- @if [ -e simv ] ; then \
- rm simv ; \
- fi
- @if [ -d csrc ] ; then \
- rm -rf csrc ; \
- fi
- @if [ -d simv.daidir ] ; then \
- rm -rf simv.daidir ; \
- fi
- @if [ -e inter.vpd ] ; then \
- rm -rf inter.vpd ; \
- fi
- @if [ -e quit.do ] ; then \
- rm -rf quit.do ; \
- fi
- @if [ -e ucli.key ] ; then \
- rm -rf ucli.key ; \
- fi
- @if [ -d DVEfiles ] ; then \
- rm -rf DVEfiles ; \
- fi
- @if [ -d INCA_libs ] ; then \
- rm -rf INCA_libs ; \
- fi
- @if [ -d cov_work ] ; then \
- rm -rf cov_work ; \
- fi
- @if [ -e hdl.var ] ; then \
- rm -rf hdl.var ; \
- fi
- @if [ -e ncelab.args ] ; then \
- rm -rf ncelab.args ; \
- fi
- @if [ -e ncvlog.args ] ; then \
- rm -rf ncvlog.args ; \
- fi
- @if [ -e ncsim.args ] ; then \
- rm -rf ncsim.args ; \
- fi
- @if [ -e ncprep.log ] ; then \
- rm -rf ncprep.log ; \
- fi
- @if [ -e ncelab.log ] ; then \
- rm -rf ncelab.log ; \
- fi
- @if [ -e ncvlog.log ] ; then \
- rm -rf ncvlog.log ; \
- fi
- @if [ -e ncsim.log ] ; then \
- rm -rf ncsim.log ; \
- fi
- @if [ -e run.tcl ] ; then \
- rm -rf run.tcl ; \
- fi
- @if [ -e RUN_NC ] ; then \
- rm -rf RUN_NC ; \
- fi
- @if [ -e ncsim.key ] ; then \
- rm -rf ncsim.key ; \
- fi
- @if [ -e cds.lib ] ; then \
- rm -rf cds.lib ; \
- fi
- @if [ -e logs ] ; then \
- rm -rf logs ; \
+ @if [ -e $(SIM_DIR) ] ; then \
+ rm -rf $(SIM_DIR) ; \
fi
- @if [ -e ../v2html_doc ] ; then \
- rm -rf ../v2html_doc ; \
+ @if [ -e $(SOCLABS_PROJECT_DIR)/html/cmsdk/build ] ; then \
+ rm -rf $(SOCLABS_PROJECT_DIR)/html/cmsdk/build ; \
fi
diff --git a/Cortex-M0/soclabs_demo/systems/cortex_m0_mcu/rtl_sim/tarmac0.log_ref b/Cortex-M0/soclabs_demo/systems/cortex_m0_mcu/rtl_sim/tarmac0.log_ref
deleted file mode 100644
index 33661eb5858d036c6469d91d378f4c6a463d1ed9..0000000000000000000000000000000000000000
--- a/Cortex-M0/soclabs_demo/systems/cortex_m0_mcu/rtl_sim/tarmac0.log_ref
+++ /dev/null
@@ -1,206821 +0,0 @@
- 0 ns E CORTEXM0_TARMAC_LOG tb_cmsdk_mcu.u_tarmac_track
- 250 ns E RESET
- 370 ns MR4_D 00000000 20000368
- 370 ns R r13 20000368 (MSP)
- 390 ns MR4_D 00000004 010002e1
- 410 ns R psr c1000203
- 430 ns R psr c1000200
- 430 ns MR4_I 010002e0 47804807
- 430 ns E LEAVE_ATOMIC
- 430 ns R psr c1000200
- 450 ns IT 010002e0 4807 LDR r0,[pc,#28] ; [0x1000300]
- 470 ns MR4_I 010002e4 47004807
- 490 ns MR4_D 01000300 010002d1
- 490 ns R r0 010002d1
- 490 ns IT 010002e2 4780 BLX r0
- 530 ns R psr c1000200
- 530 ns MR4_I 010002d0 48014902
- 530 ns R r14 010002e5
- 550 ns IT 010002d0 4902 LDR r1,[pc,#8] ; [0x10002dc]
- 570 ns MR4_I 010002d4 47706008
- 590 ns MR4_D 010002dc 20000000
- 590 ns R r1 20000000
- 590 ns IT 010002d2 4801 LDR r0,[pc,#4] ; [0x10002d8]
- 630 ns MR4_D 010002d8 05f5e100
- 630 ns R r0 05f5e100
- 630 ns IT 010002d4 6008 STR r0,[r1,#0]
- 650 ns MR4_I 010002d8 05f5e100
- 670 ns MW4_D 20000000 05f5e100
- 670 ns IT 010002d6 4770 BX lr
- 710 ns R psr c1000200
- 710 ns MR4_I 010002e4 47004807
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@@ -1,8 +0,0 @@
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-
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-** TEST PASSED **
-Test Ended
diff --git a/Cortex-M0/soclabs_demo/systems/cortex_m0_mcu/v2html_doc.tgz b/Cortex-M0/soclabs_demo/systems/cortex_m0_mcu/v2html_doc.tgz
deleted file mode 100644
index 24dc3e3ac15cf8feeb253135f75e3a0fe8ad11c8..0000000000000000000000000000000000000000
Binary files a/Cortex-M0/soclabs_demo/systems/cortex_m0_mcu/v2html_doc.tgz and /dev/null differ
diff --git a/Cortex-M0/soclabs_demo/systems/cortex_m0_mcu/verilog/cmsdk_mcu_chip.v b/Cortex-M0/soclabs_demo/systems/cortex_m0_mcu/verilog/cmsdk_mcu_chip.v
index f41f313871770d3d1ef120995ef55a9547f92774..39b38c8642625224b27410c5a0cc15471fb89d9c 100644
--- a/Cortex-M0/soclabs_demo/systems/cortex_m0_mcu/verilog/cmsdk_mcu_chip.v
+++ b/Cortex-M0/soclabs_demo/systems/cortex_m0_mcu/verilog/cmsdk_mcu_chip.v
@@ -889,7 +889,7 @@ cmsdk_ahb_rom
.AW(16), // 64K bytes flash ROM
// .AW(13), // 8K bytes flash ROM -Dhry
/// .AW(10), // 1K bytes flash ROM - Hello
- .filename("../rtl_sim/image.hex"),
+ .filename("image.hex"),
.WS_N(`ARM_CMSDK_ROM_MEM_WS_N),
.WS_S(`ARM_CMSDK_ROM_MEM_WS_S)
,.BE (BE)
diff --git a/Cortex-M0/soclabs_demo/systems/cortex_m0_mcu/verilog/tb_cmsdk_mcu.v b/Cortex-M0/soclabs_demo/systems/cortex_m0_mcu/verilog/tb_cmsdk_mcu.v
index c6fec0c92fa230f97734f059292dcf809c86637d..e122eaae7de06b4f493f86b0e4bc066001c51d91 100644
--- a/Cortex-M0/soclabs_demo/systems/cortex_m0_mcu/verilog/tb_cmsdk_mcu.v
+++ b/Cortex-M0/soclabs_demo/systems/cortex_m0_mcu/verilog/tb_cmsdk_mcu.v
@@ -353,7 +353,7 @@ reg baud_clk_del;
wire uart_clk = (FASTMODE) ? PCLK : baud_clk; //(baud_clk & !baud_clk_del);
- cmsdk_uart_capture #(.LOGFILENAME("uart2.log"))
+ cmsdk_uart_capture #(.LOGFILENAME("logs/uart2.log"))
u_cmsdk_uart_capture(
.RESETn (NRST),
.CLK (uart_clk), //PCLK),
@@ -381,7 +381,7 @@ wire ft_clk2uart;
wire ft_rxd2uart;
wire ft_txd2uart;
- cmsdk_ft1248x1_adpio // #(.ADPFILENAME("ADPFILENAME.log"))
+ cmsdk_ft1248x1_adpio // #(.ADPFILENAME("logs/adp.log"))
u_ft1248_adpio(
.ft_clk_i (ft_clk_out),
.ft_ssn_i (ft_ssn_out),
@@ -393,7 +393,7 @@ wire ft_txd2uart;
.FTDI_IP2UART_o (ft_txd2uart)
);
- cmsdk_uart_capture #(.LOGFILENAME("ft1248_op.log"))
+ cmsdk_uart_capture #(.LOGFILENAME("logs/ft1248_op.log"))
u_cmsdk_uart_capture1(
.RESETn (NRST),
.CLK (ft_clk2uart),
@@ -403,7 +403,7 @@ wire ft_txd2uart;
.AUXCTRL ()
);
- cmsdk_uart_capture #(.LOGFILENAME("ft1248_ip.log"))
+ cmsdk_uart_capture #(.LOGFILENAME("logs/ft1248_ip.log"))
u_cmsdk_uart_capture2(
.RESETn (NRST),
.CLK (ft_clk2uart),
@@ -489,7 +489,7 @@ wire ft_txd2uart;
.SE (`ARM_CM0IK_PATH.SE));
`define ARM_CM0IK_TRACK u_cortexm0_track
- cm0_tarmac #(.LOGFILENAME("tarmac0.log"))
+ cm0_tarmac #(.LOGFILENAME("logs/tarmac0.log"))
u_tarmac_track
(.enable_i (1'b1),
diff --git a/Cortex-M0/soclabs_demo/systems/cortex_m0_mcu/verilog/tbench_M0.flist b/Cortex-M0/soclabs_demo/systems/cortex_m0_mcu/verilog/tbench_M0.flist
new file mode 100644
index 0000000000000000000000000000000000000000..397c6386e360cb532ecc6fa8ca6aded3766643d8
--- /dev/null
+++ b/Cortex-M0/soclabs_demo/systems/cortex_m0_mcu/verilog/tbench_M0.flist
@@ -0,0 +1,143 @@
+//-----------------------------------------------------------------------------
+// customised example Cortex-M0 controller verilog command file
+// A joint work commissioned on behalf of SoC Labs, under Arm Academic Access license.
+//
+// Contributors
+//
+// David Flynn (d.w.flynn@soton.ac.uk)
+//
+// Copyright © 2021-2, SoC Labs (www.soclabs.org)
+//-----------------------------------------------------------------------------
+
+//-----------------------------------------------------------------------------
+// The confidential and proprietary information contained in this file may
+// only be used by a person authorised under and to the extent permitted
+// by a subsisting licensing agreement from Arm Limited or its affiliates.
+//
+// (C) COPYRIGHT 2010-2013 Arm Limited or its affiliates.
+// ALL RIGHTS RESERVED
+//
+// This entire notice must be reproduced on all copies of this file
+// and copies of this file may only be made by a person if such person is
+// permitted to do so under the terms of a subsisting license agreement
+// from Arm Limited or its affiliates.
+//
+// SVN Information
+//
+// Checked In : $Date: $
+//
+// Revision : $Revision: $
+//
+// Release Information : Cortex-M System Design Kit-r1p1-00rel0
+//
+//-----------------------------------------------------------------------------
+//-----------------------------------------------------------------------------
+// Abstract : Verilog Command File for Cortex-M0 example system
+//-----------------------------------------------------------------------------
+//
+// ================= MCU System options ===============
+// Option to select Cortex-M0+ processor in example system
++define+CORTEX_M0
+
+// =================== Tarmac Logging =================
++define+USE_TARMAC
+
+// ============= Verilog library extensions ===========
++libext+.v+.vlib
+
+// ================= Top level file ===================
+$(ARM_CMSDK_MCU_DIR)/verilog/tb_cmsdk_mcu.v
++incdir+$(ARM_CMSDK_MCU_DIR)/verilog
+
+// ============= GLIB Generic Library path =============
+$(SOCLABS_DESIGN_ROOT)/GLIB/pads/verilog/PAD_INOUT8MA_NOE.v
+$(SOCLABS_DESIGN_ROOT)/GLIB/pads/verilog/PAD_VDDIO.v
+$(SOCLABS_DESIGN_ROOT)/GLIB/pads/verilog/PAD_VSSIO.v
+$(SOCLABS_DESIGN_ROOT)/GLIB/pads/verilog/PAD_VDDSOC.v
+$(SOCLABS_DESIGN_ROOT)/GLIB/pads/verilog/PAD_VSS.v
+$(SOCLABS_DESIGN_ROOT)/GLIB/mem/verilog/SROM_Ax32.v
+
+// ================= Testbench path ===================
+-y $(SOCLABS_DESIGN_ROOT)/../arm-AAA-ip/latest/Corstone-101/logical/cmsdk_debug_tester/verilog
++incdir+$(SOCLABS_DESIGN_ROOT)/../arm-AAA-ip/latest/Corstone-101/logical/cmsdk_debug_tester/verilog
+
+// ============= MCU Module search path =============
+-y $(ARM_CMSDK_MCU_DIR)/verilog
+-y $(SOCLABS_DESIGN_ROOT)/../arm-AAA-ip/latest/Corstone-101/logical/cmsdk_apb_timer/verilog
+-y $(SOCLABS_DESIGN_ROOT)/../arm-AAA-ip/latest/Corstone-101/logical/cmsdk_apb_dualtimers/verilog
+-y $(SOCLABS_DESIGN_ROOT)/../arm-AAA-ip/latest/Corstone-101/logical/cmsdk_apb_uart/verilog
+-y $(SOCLABS_DESIGN_ROOT)/../arm-AAA-ip/latest/Corstone-101/logical/cmsdk_apb_watchdog/verilog
+-y $(SOCLABS_DESIGN_ROOT)/../arm-AAA-ip/latest/Corstone-101/logical/cmsdk_apb_slave_mux/verilog
+-y $(SOCLABS_DESIGN_ROOT)/../arm-AAA-ip/latest/Corstone-101/logical/cmsdk_apb_subsystem/verilog
+-y $(SOCLABS_DESIGN_ROOT)/../arm-AAA-ip/latest/Corstone-101/logical/cmsdk_ahb_slave_mux/verilog
+-y $(SOCLABS_DESIGN_ROOT)/../arm-AAA-ip/latest/Corstone-101/logical/cmsdk_ahb_master_mux/verilog
+-y $(SOCLABS_DESIGN_ROOT)/../arm-AAA-ip/latest/Corstone-101/logical/cmsdk_ahb_default_slave/verilog
+-y $(SOCLABS_DESIGN_ROOT)/../arm-AAA-ip/latest/Corstone-101/logical/cmsdk_ahb_gpio/verilog
+-y $(SOCLABS_DESIGN_ROOT)/../arm-AAA-ip/latest/Corstone-101/logical/cmsdk_ahb_to_apb/verilog
+-y $(SOCLABS_DESIGN_ROOT)/../arm-AAA-ip/latest/Corstone-101/logical/cmsdk_ahb_bitband/verilog
+-y $(SOCLABS_DESIGN_ROOT)/../arm-AAA-ip/latest/Corstone-101/logical/cmsdk_iop_gpio/verilog
+-y $(SOCLABS_DESIGN_ROOT)/../arm-AAA-ip/latest/Corstone-101/logical/models/clkgate
+-y $(SOCLABS_DESIGN_ROOT)/../arm-AAA-ip/latest/Corstone-101/logical/models/memories/
+-y $(SOCLABS_DESIGN_ROOT)/../arm-AAA-ip/latest/Corstone-101/logical/cmsdk_ahb_to_sram/verilog
+-y $(SOCLABS_DESIGN_ROOT)/../arm-AAA-ip/latest/Corstone-101/logical/cmsdk_ahb_to_flash32/verilog
+-y $(SOCLABS_DESIGN_ROOT)/../arm-AAA-ip/latest/Corstone-101/logical/cmsdk_ahb_to_extmem16/verilog
++incdir+$(SOCLABS_DESIGN_ROOT)/../arm-AAA-ip/latest/Corstone-101/logical/cmsdk_apb_dualtimers/verilog
++incdir+$(SOCLABS_DESIGN_ROOT)/../arm-AAA-ip/latest/Corstone-101/logical/cmsdk_apb_watchdog/verilog
++incdir+$(SOCLABS_DESIGN_ROOT)/../arm-AAA-ip/latest/Corstone-101/logical/models/memories/
+
+
+//// Optional PL230 Micro DMA controller - configure in local ../verilog/pl230_defs.v file
+/// upgrade to AAA 'rel2' version
++incdir+$(SOCLABS_DESIGN_ROOT)/../arm-AAA-ip/latest/DMA-230/logical
+$(ARM_CMSDK_MCU_DIR)/verilog/pl230_defs.v
+$(SOCLABS_DESIGN_ROOT)/../arm-AAA-ip/latest/DMA-230/logical/pl230_ahb_ctrl.v
+$(SOCLABS_DESIGN_ROOT)/../arm-AAA-ip/latest/DMA-230/logical/pl230_apb_regs.v
+$(SOCLABS_DESIGN_ROOT)/../arm-AAA-ip/latest/DMA-230/logical/pl230_dma_data.v
+$(SOCLABS_DESIGN_ROOT)/../arm-AAA-ip/latest/DMA-230/logical/pl230_udma.v
+$(SOCLABS_DESIGN_ROOT)/../arm-AAA-ip/latest/DMA-230/logical/pl230_undefs.v
+
+$(SOCLABS_DESIGN_ROOT)/IPLIB/FT1248_streamio_v1_0/ft1248_streamio_v1_0.v
+$(SOCLABS_DESIGN_ROOT)/IPLIB/ADPcontrol_v1_0/ADPcontrol_v1_0.v
+$(SOCLABS_DESIGN_ROOT)/IPLIB/ADPcontrol_v1_0/ADPmanager.v
+$(ARM_CMSDK_MCU_DIR)/verilog/cmsdk_apb_usrt.v
+
+// ============= Cortex-M0 Module search path =============
+
+-y $(SOCLABS_DESIGN_ROOT)/../arm-AAA-ip/latest/Cortex-M0/logical/cortexm0/verilog
+-y $(SOCLABS_DESIGN_ROOT)/../arm-AAA-ip/latest/Cortex-M0/logical/cortexm0_dap/verilog
+-y $(SOCLABS_DESIGN_ROOT)/../arm-AAA-ip/latest/Cortex-M0/logical/cortexm0_integration/verilog
+-y $(SOCLABS_DESIGN_ROOT)/../arm-AAA-ip/latest/Cortex-M0/logical/models/cells
+-y $(SOCLABS_DESIGN_ROOT)/../arm-AAA-ip/latest/Cortex-M0/logical/models/wrappers
+-y $(SOCLABS_DESIGN_ROOT)/../arm-AAA-ip/latest/Cortex-M0/logical/ualdis/verilog
+
+
+// ============= Cortex-M0 Include file search path =============
+
++incdir+$(SOCLABS_DESIGN_ROOT)/../arm-AAA-ip/latest/Cortex-M0/logical/cortexm0/verilog
++incdir+$(SOCLABS_DESIGN_ROOT)/../arm-AAA-ip/latest/Cortex-M0/logical/cortexm0_dap/verilog
++incdir+$(SOCLABS_DESIGN_ROOT)/../arm-AAA-ip/latest/Cortex-M0/logical/cortexm0_integration/verilog
++incdir+$(SOCLABS_DESIGN_ROOT)/../arm-AAA-ip/latest/Cortex-M0/logical/models/cells
++incdir+$(SOCLABS_DESIGN_ROOT)/../arm-AAA-ip/latest/Cortex-M0/logical/models/wrappers
++incdir+$(SOCLABS_DESIGN_ROOT)/../arm-AAA-ip/latest/Cortex-M0/logical/ualdis/verilog
+
+
+
+// =============Debug tester Include file search path =============
+
+
+// ============= OVL support libraries =============
+//+define+ASSERT_ON
+//+define+OVL_ASSERT_ON
+//+define+ARM_ASSERT_ON
+//+define+ARM_AHB_ASSERT_ON
+//+define+ARM_APB_ASSERT_ON
+//+define+ARM_CMSDK_ASSERT_ON
+
+// ============= Verification components =============
+-y $(SOCLABS_DESIGN_ROOT)/../arm-AAA-ip/latest/Corstone-101/logical/models/protocol_checkers/AhbLitePC/verilog/
++incdir+$(SOCLABS_DESIGN_ROOT)/../arm-AAA-ip/latest/Corstone-101/logical/models/protocol_checkers/AhbLitePC/verilog/
+-y $(SOCLABS_DESIGN_ROOT)/../arm-AAA-ip/latest/Corstone-101/logical/models/protocol_checkers/ApbPC/verilog/
++incdir+$(SOCLABS_DESIGN_ROOT)/../arm-AAA-ip/latest/Corstone-101/logical/models/protocol_checkers/ApbPC/verilog/
+
+///+incdir+/arm/tools/accellera/ovl/releases/ovl_v2p6_Oct2011/std_ovl
+///-y /arm/tools/accellera/ovl/releases/ovl_v2p6_Oct2011/std_ovl
diff --git a/Cortex-M0/soclabs_demo/systems/cortex_m0_mcu/verilog/v2html_M0.vc b/Cortex-M0/soclabs_demo/systems/cortex_m0_mcu/verilog/v2html_M0.vc
index bd60453ea0ba32a05f93f356955c96b334e27a46..eeebf9c7c7eb52fe65702af46e2b69329290925e 100644
--- a/Cortex-M0/soclabs_demo/systems/cortex_m0_mcu/verilog/v2html_M0.vc
+++ b/Cortex-M0/soclabs_demo/systems/cortex_m0_mcu/verilog/v2html_M0.vc
@@ -6,7 +6,7 @@
//
// David Flynn (d.w.flynn@soton.ac.uk)
//
-// Copyright © 2021, SoC Labs (www.soclabs.org)
+// Copyright © 2021-2023 SoC Labs (www.soclabs.org)
//-----------------------------------------------------------------------------
//-----------------------------------------------------------------------------
@@ -94,26 +94,26 @@
//// Optional PL230 Micro DMA controller - configure in local ../verilog/pl230_defs.v file
/// upgrade to AAA 'rel2' version
-+incdir+../../../../../../arm-AAA-ip/DMA-230_MicroDMA_Controller/PL230-BU-00000-r0p0-02rel2/shared/logical/pl230_udma/verilog
++incdir+../../../../../../arm-AAA-ip/latest/DMA-230/logical
../verilog/pl230_defs.v
-../../../../../../arm-AAA-ip/DMA-230_MicroDMA_Controller/PL230-BU-00000-r0p0-02rel2/shared/logical/pl230_udma/verilog/pl230_ahb_ctrl.v
-../../../../../../arm-AAA-ip/DMA-230_MicroDMA_Controller/PL230-BU-00000-r0p0-02rel2/shared/logical/pl230_udma/verilog/pl230_apb_regs.v
-../../../../../../arm-AAA-ip/DMA-230_MicroDMA_Controller/PL230-BU-00000-r0p0-02rel2/shared/logical/pl230_udma/verilog/pl230_dma_data.v
-../../../../../../arm-AAA-ip/DMA-230_MicroDMA_Controller/PL230-BU-00000-r0p0-02rel2/shared/logical/pl230_udma/verilog/pl230_udma.v
-../../../../../../arm-AAA-ip/DMA-230_MicroDMA_Controller/PL230-BU-00000-r0p0-02rel2/shared/logical/pl230_udma/verilog/pl230_undefs.v
+../../../../../../arm-AAA-ip/latest/DMA-230/logical//pl230_ahb_ctrl.v
+../../../../../../arm-AAA-ip/latest/DMA-230/logical/pl230_apb_regs.v
+../../../../../../arm-AAA-ip/latest/DMA-230/logical/pl230_dma_data.v
+../../../../../../arm-AAA-ip/latest/DMA-230/logical/pl230_udma.v
+../../../../../../arm-AAA-ip/latest/DMA-230/logical/pl230_undefs.v
// ============= Cortex-M0 Module search path =============
// guts of core not exposed, periphery only
--y ../../../../../../arm-AAA-ip/Cortex-M0/AT510-BU-00000-r0p0-03rel3/logical/cortexm0_integration/verilog
--y ../../../../../../arm-AAA-ip/Cortex-M0/AT510-BU-00000-r0p0-03rel3/logical/models/cells
--y ../../../../../../arm-AAA-ip/Cortex-M0/AT510-BU-00000-r0p0-03rel3/logical/models/wrappers
--y ../../../../../../arm-AAA-ip/Cortex-M0/AT510-BU-00000-r0p0-03rel3/logical/ualdis/verilog
+-y ../../../../../../arm-AAA-ip/latest/Cortex-M0/logical/cortexm0_integration/verilog
+-y ../../../../../../arm-AAA-ip/latest/Cortex-M0/logical/models/cells
+-y ../../../../../../arm-AAA-ip/latest/Cortex-M0/logical/models/wrappers
+-y ../../../../../../arm-AAA-ip/latest/Cortex-M0/logical/ualdis/verilog
// ============= Cortex-M0 Include file search path =============
// guts of core not exposed, periphery only
-+incdi+../../../../../../arm-AAA-ip/Cortex-M0/AT510-BU-00000-r0p0-03rel3/logical/cortexm0_integration/verilog
-+incdir+../../../../../../arm-AAA-ip/Cortex-M0/AT510-BU-00000-r0p0-03rel3/logical/models/cells
-+incdir+../../../../../../arm-AAA-ip/Cortex-M0/AT510-BU-00000-r0p0-03rel3/logical/models/wrappers
-+incdir+../../../../../../arm-AAA-ip/Cortex-M0/AT510-BU-00000-r0p0-03rel3/logical/ualdis/verilog
++incdir+../../../../../../arm-AAA-ip/latest/Cortex-M0/logical/cortexm0_integration/verilog
++incdir+../../../../../../arm-AAA-ip/latest/Cortex-M0/logical/models/cells
++incdir+../../../../../../arm-AAA-ip/latest/Cortex-M0/logical/models/wrappers
++incdir+../../../../../../arm-AAA-ip/atest/Cortex-M0/logical/ualdis/verilog
diff --git a/GetStarted.md b/GetStarted.md
index a07309737eb08cc1586c2131f4fc26de9fa93d2f..2d175eea32ca50e95e29a67e82fac53b78b2d88c 100644
--- a/GetStarted.md
+++ b/GetStarted.md
@@ -65,6 +65,15 @@ The microcontroller simulation hierarchy is delivered in the '**soclabs-cortexm0
```
soclabs-cortexm0-mcu
+|-- set_env.sh // source this script to set up envitonment first
+|-- html
+| |-- top
+| | |-- v2html_doc.tgz // gunzip zxvf v2html_doc.tgz for html docmentation tree
+|-- socsim.sh // call the makefile with 'clean' of 'run TESTNAME=hello' type arguments
+| simulate
+| |-- sim
+| | cmsdk // simulation build area and run logs
+| | | logs
|-- Cortex-M0
| |-- soclabs_demo
| | software
@@ -89,7 +98,7 @@ soclabs-cortexm0-mcu
| | | |-- validation
| | | debug_tester
| | systems
-| | |-- cortex_m0_cpu
+| | |-- cortx_m0_cpu
| | | |-- rtl_sim
| | | | testcodes
| | | | |-- apb_mux_tests
@@ -119,13 +128,20 @@ soclabs-cortexm0-mcu
| | | | |-- user_tests
| | | | |-- vtor_tests
| | | |-- tools
-| | | |-- v2html_doc
| | | |-- verilog
```
-## The simulation environment is run in the **rtl_sim** directory:
+## The project environment is now set up by sourcing
-` soclabs-cortexm0-mcu/Cortex-M0/soclabs_demo/systems/cortex_m0_mcu/rtl_sim`
+` set_env.sh `
+
+## The simulation environment is now run in the top ($SOCLABS_PROJECT_DIR) directory. The underlying makefile in $ARM_CMSDK_MCU_DIR/ make targets support running simulation with appropriately configured EDA simulator, with TESTMANE set for the test required (e.g. TESTNAME=hello)
+
+` socsim.sh run TESTNAME=xxx`
+
+As well as make target to clean down logs and intermediate build files:
+
+` socsim.sh clean`
A quick out-of-box test of the installation is:
@@ -134,11 +150,11 @@ A quick out-of-box test of the installation is:
3. run the simulator with the pre-built test code
```
- make code TESTNAME=hello (or another test from the `../testcodes/` directory)
- make compile_mti
- make run_mti TESTNAME=hello
+ socsim.sh code TESTNAME=hello (or another test from the `../testcodes/` directory)
+ socsim.sh compile_mti
+ socsim.sh run_mti TESTNAME=hello
```
-As well as the simulation transcript the following log files are produced:
+As well as the simulation transcript the following log files are produced in the simulate/sim/cmsdk/logs directory:
```
uart2.log -- ASCII character strings output from 'stdout' on UART2
@@ -148,7 +164,7 @@ As well as the simulation transcript the following log files are produced:
The directory can be cleaned up after running tests using:
```
- make clean
+ socsim.sh clean
```
## Getting to understand the microcontroller design:
@@ -156,7 +172,7 @@ The directory can be cleaned up after running tests using:
The design has been documented using a _verilog-to-HTML_ tool; if the `../v2html_doc.tgz` file is decompressed and unpacked an HTML directory is built (`../v2html_doc`) which can then be inspected with a web browser:
```
- firefox ../v2html_doc/hierarchy.html &
+ firefox html/top/v2html_doc/hierarchy.html &
```
This allows the exploration of design hierarchy from the testbench inwards, and cross referencing of design modules and signals.
diff --git a/README.md b/README.md
index 65dcb7022af8b972b540cd3dcb753ed04d286e14..3c9fc1682778ef7c8618bff1b717dccbc1a227d3 100644
--- a/README.md
+++ b/README.md
@@ -15,6 +15,15 @@ The microcontroller simulation hierarchy is delivered in the '**soclabs-cortexm0
```
soclabs-cortexm0-mcu
+|-- set_env.sh // source this script to set up envitonment first
+|-- html
+| |-- top
+| | |-- v2html_doc.tgz // gunzip zxvf v2html_doc.tgz for html docmentation tree
+|-- socsim.sh // call the makefile with 'clean' of 'run TESTNAME=hello' type arguments
+| simulate
+| |-- sim
+| | cmsdk // simulation build area and run logs
+| | | logs
|-- Cortex-M0
| |-- soclabs_demo
| | software
@@ -69,7 +78,6 @@ soclabs-cortexm0-mcu
| | | | |-- user_tests
| | | | |-- vtor_tests
| | | |-- tools
-| | | |-- v2html_doc
| | | |-- verilog
```
@@ -80,5 +88,9 @@ simulation setup (of the form):
export PATH=$PATH:/apps/arm/developmentstudio-2021.0/sw/ARMCompiler5.06u7/bin/
```
+soyrce set_env.sh
+html documentation provided in html/top/v2html_doc.tgz
+
+
diff --git a/html/top/v2html_doc.tgz b/html/top/v2html_doc.tgz
new file mode 100644
index 0000000000000000000000000000000000000000..90a45b850071c6737d1943d814bd148655b5c197
Binary files /dev/null and b/html/top/v2html_doc.tgz differ
diff --git a/set_env.sh b/set_env.sh
new file mode 100644
index 0000000000000000000000000000000000000000..0a222665e34f2dbb2b62b3b076e7b55fdf3ea630
--- /dev/null
+++ b/set_env.sh
@@ -0,0 +1,30 @@
+#-----------------------------------------------------------------------------
+# SoC Labs Environment Setup Script
+# A joint work commissioned on behalf of SoC Labs, under Arm Academic Access license.
+#
+# Contributors
+#
+# DF (@soton.ac.uk)
+#
+# Copyright 2023, SoC Labs (www.soclabs.org)
+#-----------------------------------------------------------------------------
+#!/bin/bash
+
+# Source set_env script from soctools_flow
+SOCLABS_DESIGN_ROOT=`pwd`
+echo SOCLABS_DESIGN_ROOT: $SOCLABS_DESIGN_ROOT
+export SOCLABS_DESIGN_ROOT
+SOCLABS_PROJECT_DIR=$SOCLABS_DESIGN_ROOT
+export SOCLABS_PROJECT_DIR
+
+ARM_IP_LIBRARY_PATH=$SOCLABS_DESIGN_ROOT/../arm-AAA-ip
+echo ARM_IP_LIBRARY_PATH: $ARM_IP_LIBRARY_PATH
+export ARM_IP_LIBRARY_PATH
+
+ARM_CMSDK_MCU_DIR=$SOCLABS_DESIGN_ROOT/Cortex-M0/soclabs_demo/systems/cortex_m0_mcu
+echo ARM_CMSDK_MCU_DIR: $ARM_CMSDK_MCU_DIR
+export ARM_CMSDK_MCU_DIR
+
+ARM_CMSDK_SW_DIR=$SOCLABS_DESIGN_ROOT/Cortex-M0/soclabs_demo/software
+echo ARM_CMSDK_SW_DIR: $ARM_CMSDK_SW_DIR
+export ARM_CMSDK_SW_DIR
diff --git a/socsim.sh b/socsim.sh
new file mode 100755
index 0000000000000000000000000000000000000000..b034e414d7b0b41b74e5346fa5f1237c24a581d4
--- /dev/null
+++ b/socsim.sh
@@ -0,0 +1,33 @@
+#-----------------------------------------------------------------------------
+# SoC Labs Simulation script for system level verification
+# A joint work commissioned on behalf of SoC Labs, under Arm Academic Access license.
+#
+# Contributors
+#
+# David Fltnn (d.w.flynne@soton.ac.uk)
+#
+# Copyright 2023, SoC Labs (www.soclabs.org)
+#-----------------------------------------------------------------------------
+
+#!/usr/bin/env bash
+
+# Get simulation name from name of script
+#SIM_NAME=`basename -s .sh "$0"`
+SIM_NAME="cmsdk/"$TESTNAME
+
+# Directory to put simulation files
+SIM_DIR=$SOCLABS_PROJECT_DIR/simulate/sim/$SIM_NAME
+
+# Create Directory to put simulation files
+mkdir -p $SIM_DIR
+cd $SOCLABS_PROJECT_DIR/simulate/sim/$SIM_NAME
+
+# Compile Simulation
+# Call makefile in cmsdk_mcu with options
+# - make clean
+# - make run_mti
+echo ${1}
+make -C $ARM_CMSDK_MCU_DIR/rtl_sim ${1} \
+ SIM_DIR=$SIM_DIR \
+ ${@:2}
+